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  • 169526HCY
  • fpga门外
    2
该楼层疑似违规已被系统折叠 隐藏此楼查看此楼
我在做一个2048点的ifft,输入的2048点数据已经完成了(第二张图信号有效的valid和结束标志tlast都拉高了),也能有输出,但是s_axis_data_tready信号一直不拉低,这是啥原因呢。。。因为要顺序变换多次,tready不正常后面就不知道咋搞。。。



  • 最爱kaik
  • fpga大坑
    6
该楼层疑似违规已被系统折叠 隐藏此楼查看此楼
你选了pipelined 吧


2026-01-03 20:38:47
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  • 169526HCY
  • fpga门外
    2
该楼层疑似违规已被系统折叠 隐藏此楼查看此楼
我选pipeline的时候确实是一直拉高的,选了基4基2的时候,输入2048点不拉低,2066点才拉低,但是输出仍然是2048点 好奇怪


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